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[ 话题 ] PCB上FPGA的同步开关噪声分析

系统级SSO的形成机制带FPGA的PCB是一个复杂的系统，可将其分为包含有源电路的晶片部分、带有嵌入式无源器件的支撑走线的封装部分，和为FPGA与外部提供连接的电路板部分。在此...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-28 |0个回复
[ 话题 ] 如何克服FPGA电路板设计挑战

选取一家供应商你面临的第一个问题当然是供应商和器件的选择。通常供应商决策倾向于你以前接触最多的那家——如果你是一位FPGA初学者当然另当别论了。或许这个...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-28 |0个回复
[ 话题 ] quartus ii 时序仿真出现了问题

两个输入管脚分别输入了一个时钟信号，而且两个信号是反相的。输出之后应该是输出端s位高电平，co为低电平才对的，但是输出出现了一些峰刺还是什么的。用功能仿真就没有这个问题。请大家帮忙...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-29 |1个回复
[ 话题 ] vivado用(* MARK_DEBUG="true" *)抓信号问题请教

为什么我想抓如下用(* MARK_DEBUG="true" *)定义的信号抓不到？reg [7:0] raw_u_gauss[0:505];(* MAR...

来自 FPGA|by 一见钟情 |发表时间 2016-10-08 |1个回复