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一：generateVerilog-2001添加了generate循环，允许产生module和primitive的多个实例化，同时也可以产生多个variable，net，task，...
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(一)Quartus警告解析 1.Found clock-sensitive change during activeclock edge at time<tim...
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Error: Specified license is not valid forthis machine
Quartus II 软件没有破解好,重新破解试...
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module datainput(DVAL,LVAL,FVAL,in,clk_m,Y_data,C_data);
input LV...
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选择File->Convert Programming Files...
Programming File Type选择JTAG Indirect Configurat...
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几乎每个FPGA设计都离不开复位，但很多工程师都没有真正关心过复位的设计。当你遇到一些奇怪的问题，也许就是由复位不当引起的。
对于同步单元，可以选择同步复位、异步复位或者不复位。...
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自动生成Tcl文件
Project -> Generate Tcl File for Project...
弹出如下对话框，设置脚本路径。
...
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WARNING:PhysDesignRules:372 - Gated clock. Clock net rd_en&n...
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驱动安装
-问题描述
Windows7系统对驱动程序的使用要求有数字签名，否则无法正常使用 -问题解决 开机按F8界面，选择禁用驱动程序签名强制
时序仿真...
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今天做SEG7模块添加74138时，出现了Error: Can't compile duplicate declarations of entity "**" into libra...
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一、摘要
将Quartus II中FPGA管脚的分配及保存方法做一个汇总。
二、管脚分配方法
FPGA 的管脚分配，除了在QII软件中，选择“Assignment...
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Using VHDL, , implement an ALU for four 4-bit input numbers A and B to produce a 4...
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1.电阻 固定电阻：RES 半导体电阻：RESSEMT 电位计；POT 变电阻；RV...
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本文通过图文讲解protel99se在win7下安装无法添加原理图库和元件库如何解决，经过测试，此解决方法是很有效的。
在win7下安装protel99se会出现无法添加原理图库...
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问：从WORD文件中拷贝出来的符号，为什么不能够在PROTEL中正常显示复：请问你是在SCH环境，还是在PCB环境，在PCB环境是有一些特殊字符不能显示，因为那时保留字。
问：n...
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摘要： 探讨使用PROTEL 设计软件实现高速电路印制电路板设计的过程中，需要注意的一些布局与布线方面的相关原则问题，提供一些实用的、经过验证的高速电路布局、布线技术，提高了高速电...
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能够应用和生产，继而成为一个正式的有效的产品才是PCB layout最终目的，layout的工作才算告一个段落。那么在layout的时候，应该注意哪些常规的要点，才能使自己画的文件...
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关于“过孔盖油”和“过孔开窗”此点(VIA和PAD的用法区分)，许多客户和设计工程师在系统上下单时经常会问这是什么意思，我的文件该选...
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我们在进行印制电路板设计前，第一步就是要选择适用的工作层。Protel 99 SE提供有多种类型的工作层。只有在了解了这些工作层的功能之后，才能准确、可靠地进行...
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数字器件正朝着高速、低耗、小体积、高抗干扰性的方向发展，这一发展趋势对印刷电路板的设计提出了很多新要求。Protel软件在国内的应用已相当普遍，然而，不...
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