-
MSP430F1121（下面简称F1121）是TI公司新近推出的一款廉价的20引脚低功耗16位Flash单片机。它所具备的多种中断功能使其应用灵活，并适用于各种不同的应用领域。
...
-
五六月份调试一个使用MSP430F2132作为主控单片机的系统，在ADC操作上遇到了些问题，现将过程分享出来，希望对初学者能有所帮助。
1. 使用ADC10模块测量电源电压，参考...
-
【问题描述】使用哪款MSP430 编程器可以用来烧断JTAG熔丝？【答复】MSP430 可用JTAG 的烧写的编程工具有：MSP-PRGS430, MSP-GANG430和MSP4...
-
在安装msp430仿真器lsd-fet430uif的usb驱动程序时,出现问题，
在inf中找不到所需段落，
解决方法如下：
1.打开widows文件下setupapi....
-
察看readme.txt
Project File Listing
/***************************************************...
-
之前已经对MSP430F4250的SD16_A进行了入门级的了解和设置，但由于项目有要求：
AD——模拟信号频率范围100~20kHz，采样率40kHz，...
-
1.关于MSP430F4250：
2.关于MSP430F4250 AD：
参考MSP430X4XXFamily User’s Guide:
关于16位AD采样...
-
求意见
上电后的效果，图中是第八号选手抢答
实物图
原理图
来自
毕业设计|by
期待 |发表时间 2015-09-23
|0个回复
-
在《都是IO弱上拉惹的祸》文中，提及了Altera的CPLD在初始化时管脚通常会处于弱上拉状态。在实际示波器采样来看，就表现在上电初期IO脚会有一个短暂（当时是持续大约几百us）的...
-
//------------------- //18B20驱动程序 by zmz // 2008.4.19 //-------------------...
-
Error:
Can't launch the ModelSim-Altera software -- the path to the location...
-
soc中如果让FPGA和HPS同时控制某一个输入或输出会不会出现矛盾？
这是我之前问别人的一个问题。
其实答案很明显，让FPGA和HPS同时控制某一个输入或输出是不可能的事情。...
-
背景：Xilinx公司的FPGA ，ISE 13.4 开发环境， verilog HDL语言
问题描述：检查语法没有错误，用modelsim仿真也可以，但...
-
一：generateVerilog-2001添加了generate循环，允许产生module和primitive的多个实例化，同时也可以产生多个variable，net，task，...
-
(一)Quartus警告解析 1.Found clock-sensitive change during activeclock edge at time<tim...
-
Error: Specified license is not valid forthis machine
Quartus II 软件没有破解好,重新破解试...
-
NIOS II 运行应用程序Run as ->Nios II Hardware时出现错误：
No Nios II target connection paths were ...
-
NiosII 下载程序过程中出现以下提示信息：
Using cable "USB-Blaster [USB0]", device ...
-
选择File->Convert Programming Files...
Programming File Type选择JTAG Indirect Configurat...
-
WARNING:PhysDesignRules:372 - Gated clock. Clock net rd_en&n...
畅学电子
