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介绍了一种使用射频技术的无线收发模块的编解码应用设计，自主调制与解调，该方式电路连接简单，传输距离远 ...
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YYJ|上传于 2015-05-08
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讨论了高速PCB 设计中涉及的定时、反射、串扰、振铃等信号完整性( SI)问题,结合高速PCB设计工 ...
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YYJ|上传于 2015-05-07
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约束所有时钟（包括你的设计中特有的时钟）对准确的时序分析结果而言是必不可少的。Quartus&nbs ...
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宝啦宝呀|上传于 2015-05-27
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Allegro16.6约束规则设置详解 ...
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龍鳳呈祥|上传于 2015-05-18
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约束管理器使用指南 ...
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龍鳳呈祥|上传于 2015-05-18
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Verilog HDL是一种很流行的硬件描述语言，不仅用于可综合RTL描述，包括组合逻辑描述和时序逻 ...
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畅学e|上传于 2015-05-13
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绍了基于AsP和ODBc技术实现网上答疑系统的方法。该系统采用SERVER7.0作后台数据库服务器， ...
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畅学e|上传于 2015-05-11
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在S0c设计中，传统功能验证方法已显示出其缺点，主要问题有：复杂验证场景难以构建；边缘情况难以覆盖。 ...
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畅学e|上传于 2015-05-09
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手机功能的增加对PCB板的设计要求更高,伴随着一轮蓝牙设备、蜂窝电话和3G时代来临,使得工程师越来越 ...
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凯瑞|上传于 2015-05-08
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在有源噪声控制中引入基于Lyapunov稳定理论的目标函数，给出了应用于有源噪声控制的约束条件，推导 ...
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宝啦宝呀|上传于 2015-05-07
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讨论了以二次等式约束条件为基础的一种改进的向量机即最小二乘向量机(LSSVM)算法，用其对话者进行识 ...
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宝啦宝呀|上传于 2015-05-05
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VerilogHDL 综合性设计
1 时钟安排
选用上升沿触发的单时钟信号,尽量不使用混合触发的 ...
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期待|上传于 2015-05-13
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设计和建造下一代电子产品是一个复杂的过程，特别是电子行业这样一个全球高度竞争的行业，在这个行业中快速 ...
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期待|上传于 2015-05-13
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第一章 在 Allegro 中准备好进行 SI 仿真的 PCB 板图第二章 转换 IBIS 库到 d ...
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期待|上传于 2015-05-11
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第一章 LINESIM 第二章 时钟网络的 EMC 分析 第三章 LINESIM'S 的 ...
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期待|上传于 2015-05-09
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北大微电子学系 于敦山 ppt文档 &nb ...
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期待|上传于 2015-05-09
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在很多设计中，CPLD 仅作为电路中的辅助元件，坦白地说，对大多数硬件开发工程师来说，CPLD 部分 ...
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期待|上传于 2015-05-05
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针对扩频通信系统的载波同步,提出一套完善的数字锁相环设计方案. 该方案利用新颖的可控根法完成1～3阶 ...
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YYJ|上传于 2015-04-25
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人们一直希望便携式超声系统能以低成本提供出色的分辨率。便携式系统使医疗保健服务提供商能够 ...
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Dabing|上传于 2015-04-02
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源自板加工和装配要求的约束一直在推动着 PCB 设计的发展。当前，差分对、BGA、低压器件和高速并行 ...
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Dabing|上传于 2015-03-31
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